INFORME PREVIO N°4

UNIVERSIDAD NACIONAL MAYOR DE SAN MARCOS Facultad de Ingeniería Electrónica y Eléctrica E.A.P. Ingeniería Electrónica

Laboratorio de Circuitos Digitales I Informe Previo Nº 4 TEMA:

Circuito Sumador, Circuito comparador, Circuito generador de paridad con CI-MSI.

CURSO:

Circuitos Digitales I

ALUMNO:

Cuba Miranda, Lucero Milagros.

CÓDIGO:

15190005

PROFESOR:

Ing. Casimiro Pariasca, Óscar

2017-1

UNMSM  – FIEE

LAB. DE CIRCUITOS DIGITALES I

INFORME PREVIO Nº 4 1. Presentar los diagramas esquemáticos y las tablas de verdad de los C.I. M.S.I. concernientes a esta práctica (74LS83, 74LS85, 74LS86)

SUMADOR BINARIO 74LS83 El circuito integrado 7483 implementa un sumador binario completo de 2 números de 4  bits. Su configuración es la que se muestra en la figura 1.

CARACTERÍSTICAS: Sumador de dos números binarios de 4 bits c/u Carry rápido: 10 ns típico Genera señal de carry cuando la suma excede 15 Se pueden configurar varias unidades en cascada para sumar números de mayor cantidad de bits Puede operar con lógica positiva o negativa Tecnología: TTL Low Schottky (LS) Voltaje de alimentación: 4.75 V a 5.25 V Encapsulado: PDIP 16 pines    

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DIAGRAMA DE TERMINALES:

Donde: A3-A0 y B3-B0  son los dos números a sumar. Siendo A3 y B3 los bits más significativos, mientras que A0 y B0 son los menos significativos. C0 es el acarreo de entrada. S3-S0 son las salidas del circuito. C4 es el acarreo de salida. En conjunto, C4:S3:S2:S1:S0 forman el resultado de la operación.

Figura 1. Terminales del circuito integrado 7483

8 de mayo de 2017

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TABLA DE VERDAD:

DIAGRAMA ESQUEMÁTICO:

8 de mayo de 2017

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COMPARADOR 74LS85 Comparador de magnitud de 2 números de hasta 4 bits en código binario ó BCD directo (84-2-1). Indica A>B, A=B y AB, A=B y A