Digitales_Informe Previo 4 (2)
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Descripción: laboratorio de digitales...
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I.- OBJETIVOS 1. Comprobar Comprobar el funciona funcionamiento miento de de los ip ops ops en Máquinas Máquinas de de estados estados Finitos. 2. Co Comp mprroba obar el func funcio iona nami mien ento to de los los ip ops ops en regis egistr tros os y contadores. 3. Compro Comprobar bar el funciona funcionamien miento to de memorias memorias tipo tipo 2716 yo 2732! as" como la 6116 #$%M &'()(*C%+
II.- MATERIALES 1. Fuente uente regul regulada ada de ,,- /C /C 2. Circuitos Circuitos *ntegrado *ntegrados0 s0 tiliados tiliados en las eperienc eperiencias ias anteriores anteriores!! asimismo escoger entre los siguientes0 7476! 7415! 74153! 2716! 2732! 6116! 4116! 2114 3. $es $esist istenc encias ias de 33! 33! 8 9. 4. /iod /iodos os :&/. &/. -. /isp /isplay lay de de 7 segme segment ntos os.. 6. ;rot ;rotob oboa oarrd. 7. Cable Cable telef< telefibrador capa de permanecer en uno de dos estados posibles dura durant nte e un tiem tiempo po inde inde?n ?nid ido o en ause ausenc ncia ia de pert pertur urba baci cion ones es.. &sta &sta cara ca ract cter er"s "sti tica ca es am ampl plia iame ment nte e util utili iad ada a en elec electr tros por ancos los tipos B! ( y /. :os biestables se crearon para eliminar las de?ciencias de los l os latc@es. %plicaciones0 n biestable puede usarse para almacenar un bit. :a informacialor de un contador! un carácter %'C** en la memoria de un ordenador! o cualquier otra clase de informacia en la entrada de reloA @ace que el biestable cambie de estado por cada transiciel 1. :a salida de un biestable puede conectarse a la entrada de relo reloAA de la sigu siguien iente te y as" as" suce sucesi si>a >ame ment nte. e. :a salid salida a ?nal ?nal del del co conAu nAunt nto o considerado como una cadena de salidas de todos los biestables es el conteo en cálid ida a mien mientr tras as los ca camb mbio ioss se prop propag agan an por por la cadena Austo despuGs de un anco de reloA. Hay dos soluciones a este problema. :a primera es muestrear la salida sálida. :a segunda! más compleAa y ampliamente usada! es utiliar un tipo diferente de contador s"ncrono! que tiene una lisiisio de esta máquina se muestra en la ?gura! donde se obser>a que las salidas del sistema son tanto sincrUIENTE LQ 1 1 1 1 P #PN1+
$&(&JC*RJ M&MK$*% $&'&( '&( JK
1
1
1
1
P #PN1+
;&$M*(*/K
2. I6(,+6+'ta* +, c&*c%&t) + ,a @4%*a 6)5t*aa. C),)$%+ ,a ,'+a + &'&c&) a ,%+4) c),$%+,a a 1 C%G, +5 5+c%+'c&a 5+4%&a ()* "B "A R+t)*'+ ,a ,'+a + &'&c&) a "% )c%**+ +' ,a 5a,&a a, *+c&&* 6G5 (%,5)5 + *+,) C),)$%+ +' ,a 5a,&a + "A "B ,+5 (a*a 8+* ,a 5+c%+'c&a + 5a,&a ,) $%+ )c%**+ a, *+c&&* 6G5 (%,5)5 + *+,) VCC 5V
U1A
2
4
~1PR
1J
1
1Q
15
4 1
1CLK
16
1K
U1B
2
~1PR
~1Q
14
16
~1CLR 3
1Q
15
~1Q
14
1J 1CLK 1K
~1CLR
7476N
7476N
3
CK
INICIO
'*M:%C*KJ0
t:
t
t:
VCC 5V
t:
U1A
2
1
VCC
16
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1J
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15
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5V
14
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15
1Q
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16
1
1K
VCC
14
~1Q
~1CLR
7476N
VCC
16
5V
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3
1
VCC
16
1Q
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4
5V
15
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14
1CLK
16
1K
~1CLR
1
1K
~1Q
14
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QB 1Q
15
~1Q
14
1J 1CLK 1K
~1CLR
~1CLR
7476N
7476N
3
INICIO
t:
~1CLR
7476N
3
QB 1Q
1J
1
1CLK 1K
U1B
2 ~1PR
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CK
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2 ~1PR 4
15
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3
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CK
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U1B
2 ~1PR
QA
1J
7476N
3
U1A
2
QB
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1
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2
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7476N
3
CK
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VCC
~1PR 4 1
VCC U1A
2 ~1PR 4 1
VCC
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15
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2
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16
16
5V
1Q
15
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1J
3
7476N
INICIO
CK
INICIO
t:
Laboratorio de Digitales I
EE635M
1Q
D5D
4 1
1CLK 1K
~1Q
3
CK
1CLK 1K
1J
U1B
2 ~1PR
QA 15
14
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QB
~1CLR
7476N
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2
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15
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1J 1CLK 1K
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3
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VCC
t:
VCC
t:
5V
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2 ~1PR 4
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1
VCC
16
1Q
4 1
1CLK 1K
5V
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U1B
2 ~1PR
QA 15
14
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1Q
15
4 1
1CLK 1K
~1Q
VCC
14
16
1Q
4
1CLK ~1Q
14
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CK
INICIO
INICIO
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1
VCC
16
5V
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14
4 1
1CLK 1K
16
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2 ~1PR
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7476N
3
t:
t: 4
14
VCC 5V
2
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1CLK 1K
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VCC
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~1CLR
7476N
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U1B
2 ~1PR
QA
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CK
CK
INICIO
INICIO
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2 ~1PR
QA
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7476N
3
U1A
2 ~1PR
QB
QB 1Q
15
~1Q
14
1J 1CLK 1K
~1CLR
7476N
7476N
3
:a secuencia seguida por L% y LS lo >emos meAor en el mismo ipDop
VCC 5V
U1A
2 ~1PR 4 1 16
1Q
15
~1Q
14
1J
4 1
1CLK 1K
16
~1CLR 3
U1B
2
--1111--1111 QA
~1PR
QB
1J
15
1Q
-11-11-11-11
1CLK 1K
14
~1Q ~1CLR
7476N
3
7476N -11-11-11-11
CK
INICIO
CN1 CN
-1111-1111-1111-1111
$&(&JC*KJ K;&$%C*RJ JK$M%:
´ PR
CL
1
1
1
1
´
SALIDA FLIPKFLOP %MS*O% '&( #LN1+ $&'&(#LN+ K;&$%C*RJ JK$M%:
J 1
1
1
1
"? L 1 ´ Q
'i a *J*C*K lo colocamos nue>amente a TU por más que siga el pulso de reloA! la salida LS será siempre cero LSN Laboratorio de Digitales I
EE635M
D 1 D
Universidad Nacional de Ingeniería Facultad de Ingeniería Eléctrica y Electrónic a
3.- Pa*a +, 5&4%&+'t+ &a4*a6a + +5ta)9 a,,a*
a+ b+ c+ d+ e+
(abla de estado. (abla de estado reducida. *mplementar el circuito con FF B. Hallar la secuencia de estados cuando N. Hallar la secuencia de estados cuando N1.
S),%c&' a+ :a tabla de estados es la siguiente y como >emos no se puede reducir as" que será la tabla de estados reducida tambiGn. b+ (abla $educida0
1 2 3 4 6
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&ntrada 1 3 -1 6 1 1 2 -1 -1 2 -1 4 2
D 11 D
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c+ Circuito con FF B0 &l siguiente paso será @acer nuestra tabla de transiciones y nuestra tabla de ecitaciN EL PROCEDIMIENTO SI>UIENTE CREAR EL ES"UEMATICO ASI>NAR PINES DE ENTRADA W SALIDA CONECTAR LOS SIMBOLOS EDITAR LOS NOMBRES DE LOS PINES ASI>NAR NUMERO DE PINES COMPILAR EL PROWECTO SIMULAR EL PROWECTO &l problema nos pide implementar la secuencia0 -! 7! 2! ! 4! -!.. Hacemos la secuencia requerida0 11D111D1DD1D11DX Hacemos la tabla de estados0
&'(%/K %C(%: C 1 1 1 1
S 1 1 1 1
&'(%/K '*O*&J(& C, S, 1 D D D D 1 1 1 D D 1
% 1 1 1 1
%, D D 1 1 D
Bc 1 D D D
c D D D 1
%plicamos arnaug@0
1
1
P
1
P
1
11
P
11
1
1
Jc =B A
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1
1
Kc= CBA
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D 24 D
Bb D D 1 D
b D 1 D D
Ba D D 1 D
a D P D D 1
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1
1
1
1
11
P
11
1
1
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1
Kc= C A
Jb = CA
1
1
1
P
1
11
P
11
1
1
Jc = C B
1
P
1
Kc= CBA
&l circuito implementado en M%P ;:' ** es el siguiente0
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;ara compilar el diseEo! usamos %''*OJ Y /&*C&! y asignamos los siguientes atributos0
:uego compilamos el diseEo0
W >emos que no presenta errores0
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D 26 D
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Finalmente podemos simular el proyecto0 samos Z%&FK$M &/*(K$ para crear las formas de onda. samos &J(&$ JK/&' F$KM 'JF0
emos la simulaciN EL PROCEDIMIENTO SI>UIENTE CREAR EL ES"UEMATICO ASI>NAR PINES DE ENTRADA W SALIDA CONECTAR LOS SIMBOLOS EDITAR LOS NOMBRES DE LOS PINES ASI>NAR NUMERO DE PINES COMPILAR EL PROWECTO SIMULAR EL PROWECTO Hacemos la grá?ca de estados0
Hacemos la tabla de estados teniendo en cuenta0 %N
SN1 CN1 /N11
&'(%/K %C(%: L1 1 1 1 1
LK 1 1 1 1
1 1 1 1
&'(%/K '*O*&J(& L1[ LK[ 1 1 \ 1 1 1 1
1
%plicamos arnaug@ y conseguimos0 B1NLo 1NLo BoN L1 oN L1 Lo Laboratorio de Digitales I
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B1 1 P P P P
1 P P P P 1 1
Bb 1 P P 1 P P
P P 1 1 P P 1
Universidad Nacional de Ingeniería Facultad de Ingeniería Eléctrica y Electrónic a
&l circuito implementado es0
Compilaci
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